7nm : 台积电 VS 三星
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内存的故事--风风雨雨50年
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IC大牛10多年的设计分享：数字典型电路知识结构地图及代码实现
深度聊聊MOS管
32GT/s PCIe 5.0，SOC芯片关键设计与挑战
关于华为海思，这篇文章值得一看
俄国没有高端芯片，为什么却能造出一流武器？
别拦我，我要做芯片！
芯片春秋·ARM传
中国芯酸往事
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国防军工芯片行业深度报告
一位美国芯片公司华人高管对中国芯片行业的思考
学习、积累、交流-IC设计高手的成长之路
女生学微电子是一种什么体验？
MIPS架构开放了，10天设计一款完全免费的MIPS处理器（附源码）
性能之殇：从冯·诺依曼瓶颈谈起
AI芯片设计与开发概览
AI 芯片和传统芯片有何区别？
一个资深工程师老王关于AI芯片的技术感悟
隔隔壁老王：AI芯片与她怎么选？
终于有人把云计算、大数据和人工智能讲明白了！
尺寸减半、功率翻番！——氮化镓技术的现在和未来
逻辑综合 Design Compiler 资料大全
集成电路制造技术简史
什么是AMI与IBIS？如何轻松完成DDR5设计？
- 半导体科普：IC芯片设计及生产流程
- 晶圆代工争霸战四部曲(了解各晶圆厂的前世今生，非常详细！)
- 非常详细的半导体工艺流程讲解
- 射频半导体工艺介绍
版图中Metal专题——线宽选择
有哪些只有IC工程师才能get到的梗？
为什么7nm工艺制程这么难？从7nm看芯片行业的“贫富差距”
什么是台积电的SoIC？
RISC-V打入主流市场的诸多问题
RISC-V架构有何优势？
关于RISC-V 终于有人讲明白了！
- RISC-V软核+FPGA 航天军工产品设计新机遇
ASIC低功耗设计实例分析及书籍推荐
- ASIC设计学习总结(包括：工具及书籍文档推荐 、软件环境搭建、RTL设计、验证、工艺库说明、形式验证、综合等共12部分）
ASIC设计学习总结之可测性设计及书籍推荐
ASIC设计学习总结之静态时序分析概要及书籍推荐
ASIC设计学习总结之工具及书籍文档
小芯片大价值 | ASIC工程师如此值钱到底为什么？
芯片面积估计方法简介
自主研发通信芯片有多难？通信行业老兵告诉你，没那么简单！
RISC-V精简到何种程度？能省的都省了！
多核CPU设计及RISC-V相关资料
时序设计与约束资料汇总
模拟版图讲义
GDSII转DEF的flow简介
机器学习将越来越依赖FPGA和SoC
Verilog基本功之：流水线设计Pipeline Design
先进封装发展趋势分析PPT
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可测试性设计与ATPG
麒麟980是如何诞生的？敢于失败，勇于尝试！（附：华为早期型号处理器研发过程）
IC模拟版图设计讲义
Verilog CPU设计实例
CPU、GPU 和 TPU 都是如何工作的？有什么区别？TPU为什能碾压GPU?
流行数十年的主流芯片架构正在悄然巨变
与IC设计产业相比，EDA产业发展的难处有哪些？
千兆以太网 TCP， UDP协议， FPGA实现
SoC功能仿真验证技术分享
对验证的一些理解
IC Layout 脚本分享
异构整合，半导体下一个关键
用Python编写FPGA以太网MAC（附源码下载方式）
用python进行机器学习
直接产生verilog的testbench的python脚本
干货！ASIC牛人之经典总结
ASIC前后端设计经典的细节讲解
资料分享|时序分析
Verilog基本电路设计（包括：时钟域同步、无缝切换、异步FIFO、去抖滤波）
128点 FFT verilog代码分享
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FPGA正变成“瑞士军刀”, 越来越像SoC
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Xilinx FPGA入门连载2：Modelsim SE 10.1安装
Xilinx FPGA入门连载4：ISE中使用notepad++的关联设置
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跟着我从零开始入门FPGA（一周入门系列）：第三天：时序逻辑设计
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跟着我从零开始入门FPGA（一周入门系列）-第六天：有限状态机
跟着我从零开始入门FPGA（一周入门系列）：第七天：设计一个只有4条指令的CPU
FPGA入门连载一：0和1——精彩世界由此开始
FPGA入门连载二：Verilog/VHDL语法学习的经验之谈
FPGA入门连载三：表面现象揭秘——逻辑关系
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